一名本科生帮助朋友优化一款慢速8位横版卷轴游戏。瓶颈在于复制28×28的背景图块。在展开循环并减少后自增后,他们使用6809的PSHS/PULS和DP寄存器,通过征用两个栈寄存器,以56个周期复制行。这会扭曲图块(行和七位组顺序颠倒),因此图块被预处理以反转七位组顺序,使重绘正确。例程快了70%。后来,绘图期间的声音中断破坏了内存,因为S指向参考图块。他们交换了S和U,使中断改为破坏屏幕缓冲区,然后从右到左、从下到上绘制图块,使破坏在显示前被覆盖。结果:游戏流畅,技巧完美。
一名本科生帮助朋友优化一款慢速8位横版卷轴游戏。瓶颈在于复制28×28的背景图块。在展开循环并减少后自增后,他们使用6809的PSHS/PULS和DP寄存器,通过征用两个栈寄存器,以56个周期复制行。这会扭曲图块(行和七位组顺序颠倒),因此图块被预处理以反转七位组顺序,使重绘正确。例程快了70%。后来,绘图期间的声音中断破坏了内存,因为S指向参考图块。他们交换了S和U,使中断改为破坏屏幕缓冲区,然后从右到左、从下到上绘制图块,使破坏在显示前被覆盖。结果:游戏流畅,技巧完美。
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评估套件包括 22 个 campaign、25 个 TIS-NET 和 8 个 tournament 谜题,分为 19 个简单、17 个中等和 19 个困难任务。每个模型–谜题配对有一次 pass@1 评分回合;未解谜题得分为零。对照 2026 年 10 月 15 日社区排行榜,模型在 23 个谜题上产生了 154 个候选前沿点,去重后为 18 个谜题上的 133 个点,通过新游戏回放与 100,000 项测试。记录接近度为各指标上社区记录与模型最佳得分比值的平均值。程序在 MIT 许可下公开。两个可回放但随机测试失败的点被纳入,但不计入前沿点。成本与 token 按 2026 年 10 月 API 价格估算;游戏调用按已分发工具计数。
遍历性文学是要求读者付出非平凡努力去遍历的写作,而不仅是普通阅读。Espen Aarseth 创造了这一术语,并将其嵌入他的“赛博文本”概念中,这是一种关于文本机器如何计算或排列输出而非一种文体类型的观点。Aarseth 区分了文本子(编码符号)与脚本子(面向读者的符号),然后从七个维度对文本进行分类:动态性、可确定性、瞬时性、视角、访问、链接和用户功能。这些维度产生 576 种可能的媒介位置。如果一个文本要求除解释之外至少一种用户功能——探索、配置或永久性改变——它就是遍历性的。因此,印刷作品和数字作品都可以是遍历性的。示例包括 B.S. Johnson 的《The Unfortunates》、超文本小说、游戏书、MUD、《Colossal Cave Adventure》、《Pale Fire》,以及许多后来的实验性作品。
在人工智能塑造的时代,古怪与创造力比死记硬背的技能更重要,因为语言模型擅长记忆和档案研究,却仍困于缺乏研究品味的“中位”视角。作者回忆起牛津科学史学者艾伦·查普曼博士,其古怪的好奇心改变了人生。查普曼通过“无用”的异域知识——苏美尔六十进制数学、燃素理论——进行教学,坚持科学史需要进入过时的世界观,而非复述凯旋式的发现。这种“无用知识”构成了研究品味的基础。他深奥的知识覆盖面(罗伯特·胡克、安提基特拉装置、中世纪自动机)体现了不靠逆反心理的非显而易见思考。随着 AI 代理越来越多地引导研究,我们必须抵制认识论的收窄;模型执行定义明确的任务,却难以进行开放性探索。我们需要能够进入异域过往世界观的人,扩展的不只是我们所知,还有我们如何思考。查普曼对异域知识体系的热情投入永远改变了作者的观念。
Tendrils 在 Benchmark 领投的一轮融资中筹集了 3000 万美元,以围绕数千个并行核心重建通用 CPU,而非传统顺序设计。它还在开发面向并行优先架构的开源 Vine 语言。投资者包括 Visionaries Club、英国主权人工智能基金等;Jack Altman 加入董事会。Tendrils 正在招聘。
创建一个环面命令,提示选择中心点,让用户通过实时圆预览设置主半径,然后询问管半径,并将生成的环面添加到文档。
本章描述 FPGA–DRAM 接口及启动时调优。命令/地址信号按 rank 共享,数据为双向并拆分为字节通道,每个通道拥有各自的 DQS 选通。DDR 采用源同步 DQS:写操作中心对齐,读操作边沿对齐并延迟四分之一时钟。Fly-by 路由导致各通道偏斜,因此写均衡将 DQS 对齐到各芯片的时钟;写延迟校准与 DQ-DQS 训练随后调整整时钟及逐引脚时序。读均衡查找每通道的粗比特滑移与精细输入延迟,可选用 DDR MPR 模式。终结、驱动强度与 ZQ 校准维持信号完整性;还涵盖 DDR4 VREF 处理与 FPGA 侧 VREF。由于 DRAM 时钟超过 fabric 速度,PHY 使用串行器/解串器按频率比(例如 1:4),时钟包括 sys、sys4x、sys4x_dqs 和 clk200。控制器与 PHY 通过 DFI 阶段通信,涉及写/读延迟与 rdphase/wrphase。LiteDRAM 通过平台 pad、PHY 设置/寄存器及 BIOS 校准例程实现这些机制。
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